CHAPITRE 4 Microprocesseur 68000
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- Eléonore Lebrun
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1 CHAPITRE 4 Microprocesseur Les bus 4-2- Registres internes 4-3- Modes d adressage 4-4- Jeu d instruction 4-5- Pile 4-6- Sous programme 4-7- Création d une zone tampon 1
2 Jeu d instructionsd 4-4 Opération de transfert Opérations arithmétiques Opérations Logiques Opération de décalage Branchement Branchement avec décrémentation 2
3 Opération de transfert Instruction Taille de l'opérande Opération MOVE 8, 16, 32 [AEd] [AEs] MOVEQ 8 vers 32 bits [Dn] donnée immédiate MOVEA 16, 32 vers 32 bits [An] [AEs] MOVEM 16, 32 [AEd] Dn, Rn MOVEP 16, 32 Voir les manuels LEA 32 [An] AEs PEA 32 [] [] - 4 [M([])] AEsL EXG 32 Xi Xj 3
4 Opérations arithmétiques tiques Mnemonic Description Operation ADD Add binary (destination)+(source) destination ADDA Add address (destination)+(source) destination ADDI Add immediate (destination)+immediate data destination ADDQ Add quick (destination)+immediate data destination ADDX Add extended (destination)+(source)+x destination ABCD Add decimal with extend (destination) 10 +(source) 10 +X destination SUB Subtract binary (destination)-(source) destination SUBA Subtract (destination)-(source) SUBI address Subtract Immediate destination (destination)-immediate data destination 4
5 Opérations arithmétiques tiques Mnemonic Description Operation SUBQ Subtract quick (destination)-immediate data destination SUBX Subtract with extend (destination)-(source)-x destination MLUS Signed multiply (destination)*(source) destination MULU Unsigned multiply (destination)*(source) destination DIVS Signed divide (destination)/(source) destination DIVU Unsigned divide (destination)/(source) destination EXT Sign extend (destination) sign extended destination NEG Negate 0 - (destination) destination NEGX Negate with extend 0 - (destination) X destination 5
6 Opérations logiques Mnemonic Description Operation EOR Exclusive OR (destination) (source) (destination) logical EORI Exclusive OR immediate (destination) immediate data (destination) NOT Logical ~(destination) (destination) complement OR Or logical (destination) OR (source) (destination) ORI Or immediate (destination) OR immediate data (destination) AND And logical (destination) AND (source) (destination) ANDI And immediate (destination) AND immediate data (destination) BCLR Test a bit and clear ~(<bit number>) OF destination Z 0 ~(<bit number>) OF destination BSET Test a bit and set ~(<bit number>) OF destination Z 1 ~(<bit number>) OF destination 6
7 Opérations de décalaged 7
8 Branchement sans condition Mnemonic Description Operation BRA Branch always PC + Displacement PC JMP Jump Destination PC Déplacement se fait sur 16 bits Modes d'adressage pour l instruction JMP (An), d16(an), d8(an, Xns), adr, d16(pc), d8(pc, Xns) 8
9 Branchement conditionnel Mnémonique Texte Branchement si Pour les nombres BCC Branch Carry Clear C=0 BCS Branch Carry Set C=1 BEQ Branch Equal Z=0 (non) signé BNE Branch Not Equal Z=1 signés BGE Branch Greater or Equal N=V signés BGT Branch Greater Than N=V ET Z=0 signés BHI Branch HIgher than C=0 ET Z=0 non signés BLE Branch Less or Equal Z=1 OU NV signés BLS Branch Lower or Same C=1 OU Z=1 non signés BLT Branch Less Than N=~V signés BMI Branch Minus N=1 signés BPL Branch Plus N=0 signés BVC Branch V Clear V=0 BVS Branch V Set V=1 BRA BRanch Always Sans condition 9
10 Branchement avec décrd crémentation Mnémonique Texte Branch if nombres DBCC Decrease and Branch Carry Clear C=0 DBCS Decrease and Branch Carry Set C=1 DBEQ Decrease and Branch EQual Z=0 (non) signé DBNE Decrease and Branch Not Equal Z=1 signés DBGE Decrease and Branch Greater or Equal N=V signés DBGT Decrease and Branch Greater Than N=V ET Z=0 signés DBHI Decrease and Branch HIgher than C=0 ET Z=0 non signés DBLE Decrease and Branch Less or Equal Z=1 OU NV signés DBLS Decrease and Branch Lower or Same C=1 OU Z=1 non signés DBLT Decrease and Branch Less Than N=~V signés DBMI Decrease and Branch MInus N=1 signés DBPL Decrease and Branch PLus N=0 signés DBVC Decrease and Branch V Clear V=0 DBVS Decrease and Branch V Set V=1 DBRA Decrease and BRanch Always - DBF(DBRA) Decrease and BRanch never terminate - DBT Decrease and BRanch always terminate - 10
11 PILE (Empilement 16 bits) 4-5 D0 $ $FFFF02 $FFFF MOVEW D0,-() xx xx de pile () de pile () Pile LIFO (Last in First out) 11
12 PILE (Dépilement 16 bits) 4-5 D0 $xxxxxxxx $xxxx5678 $FFFF $FFFF02 MOVEW ()+,D de pile () de pile ()
13 PILE (Empilement 32 bits) 4-5 D0 $ $FFFF04 $FFFF MOVEL D0,-() xx xx xx xx de pile () de pile ()
14 PILE (Dépilement 32 bits) 4-5 D0 $xxxxxxxx $ $FFFF $FFFF04 MOVEL ()+,D de pile () de pile ()
15 PILE (Empilement multiple) 4-5 D0 $ D1 $ D3 $ A $FFFF06 $FFFF xx xx xx xx xx xx xx xx MOVEMW D0/D1/D2,-() MOVEMW D0-D2,-() de pile () de pile () 9A
16 Sous-programme 4-6 BSR puiss instr1 instr2 BSR instr3 instr1 instr2 RTS puiss PC --> -() PC <-- PC+d PC <-- ()+ Remarquer l utilisation de la pile pour sauvegarder l adresse de retours 16
17 Sous-programme 4-6 JSR puiss instr1 instr2 BSR instr3 instr1 instr2 RTS puiss PC --> -() PC <-- puiss PC <-- ()+ 17
18 Exemple E7C 0F FF C C 303C EB E F01 101A C C1C1 101E 221F E75 ORG $10 MOVEA #$FFF, MOVEL #$ ,D1 MOVEW #56,D0 JSR carre TRAP #0 carre MOVEL D1,-() MOVEW D0,D1 MULS D1,D0 MOVEL ()+,D1 RTS 18
19 Exemple (suite) E7C 0F FF C C 303C EB E40 ORG $10 MOVEA #0FFF, MOVEL #$ ,D1 MOVEW #56,D0 JSR carre TRAP #0 D1 D F FF 0F FE FC FFEF9 FFEFA FFEFB FFEFC FFEFD FFEFE FFEFF FFF PILE PC
20 Exemple (suite) F01 101A C C1C1 101E 221F E75 Carre MOVEL D1,-() MOVEW D0,D1 MULS D1,D0 MOVEL ()+,D1 RTS D1 D F FE FC 38 0F FE F F FE F8 0C 40 FFEF8 FFEF9 FFEFA FFEFB FFEFC FFEFD FFEFE FFEFF FFF PILE 20
21 Exemple (suite) F01 101A C C1C1 101E 221F E75 Carre MOVEL D1,-() MOVEW D0,D1 MULS D1,D0 MOVEL ()+,D1 RTS D1 D F FE FC 38 0F FE FC F FE F8 0C 40 FFEF8 FFEF9 FFEFA FFEFB FFEFC FFEFD FFEFE FFEFF FFF PILE PC
22 1018 2F01 101A C C1C1 101E 221F E75 Exemple (suite) Carre MOVEL D1,-() MOVEW D0,D1 MULS D1,D0 MOVEL ()+,D1 RTS 4-6 D1 D F FE FC F FE F8 0C 40 0F FE FC 0F FF PC FFEF8 FFEF9 FFEFA FFEFB FFEFC FFEFD FFEFE FFEFF FFF PILE Il faut absolument la parité entre les empilements et les dépilements 22
23 Création d une d zone tampon 4-7 FFDFE FFDFF FFE PILE de Pile Zone tampon libre de taille $1 PILE de Pile FFF FFF 23
24 Création d une d zone tampon 4-7 FFDFE FFDFF FFE A6 0F FF CAFE PILE LINK A6,-#$1 de Pile FFF 24
25 Création d une d zone tampon 4-7 FFDFE FFDFF FFE A6 0F FF CAFE LINK A6,#-$1 de Pile FFEFC FFF CA FE PILE A6 0F FEFC 25
26 Création d une d zone tampon 4-7 FFDFA FFDFB FFDFC A6 0F FF CAFE de Pile $1 Octets Libres LINK A6,#-$1 A6 FFEFC FFF CA FE PILE A6 0F FEFC 0F DFC (=FFEFC-1) 26
27 Récupération de la zone tampon A6 0F FEFC FFDFA FFDFB FFDFC FF DFC de Pile $1 Octets de la zone UNLK A6 A6 FFEFC FFF CA FE PILE 0F FEFC 27
28 Récupération de la zone tampon A6 0F FEFC FFDFA FFDFB FFDFC FF DFC UNLK A6 de Pile FFEFC FFF CA FE PILE 0F FEFC 28
29 Récupération de la zone tampon A6 0F FEFC FFDFA FFDFB FFDFC FF DFC UNLK A6 FFEFC FFF CA FE PILE A6 0F FEFC CAFE de Pile 0F FF 29
30 Application, passage des paramètres 4-7 Deux piles différentes Exemple : un sous programme qui calcule la somme des éléments dans un tableau On lui envoie l adresse du tableau et le nombre des éléments LINK A6,#-$20 créer un espace de $20 octets LEA TABLE(PC),A0 MOVEL A0,-(A6) empiler l adresse MOVEW #TAILLE,-(A6) empiler la taille JSR Somme Somme MOVEML,-() sauvegarder les reg qui vont changer MOVEW (A6)+,D0 récupérer la taille MOVEAL (A6)+,A1 récupérer l adresse du tableau MOVEML ()+, RTS 30
31 Application, zone de travail 4-7 Moyennant LINK, on peut créer une zone de mémoire temporaire pour les sous programmes Exemple: Subrtn LINK A6,#-12 Create a 12-byte workspace MOVE D3,-8(A6) Accès aux éléments de mémoire via A6 UNLK A6 récupération de la zone RTS Retourner au prog principal 31
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