Chapitre 10: mémoires à semi-conducteurs
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- Basile Grégoire
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1 Systèmes logiques programmables Chapitre 10: mémoires à semi-conducteurs Généralités Mémoires mortes (ROM) Ø Types, caractéristiques et structure interne de ROM Mémoires vives (RAM) Ø Types et structures de SRAM et DRAM Mémoires de masse (magnétiques, optiques) Autres mémoires à semi-conducteur. Mohamad Sawan et collaborateurs
2 Généralités ELE3311 Systèmes logiques programmables Page 2
3 Généralités ELE3311 Systèmes logiques programmables Page 3
4 Systèmes logiques programmables Page 4 Généralités (suite)
5 Systèmes logiques programmables Page 5 Généralités (suite)
6 Systèmes logiques programmables Page 6 Généralités (suite)
7 Systèmes logiques programmables Page 7 Généralités (suite) Tendance générale des circuits intégrés (projection) An Overview of Manufacturing Yield and Reliability Modeling for Semiconductor Products IEEE Proceedings, Août 1999.
8 Systèmes logiques programmables Page 8 Généralités (suite) TSMC Logic Technology Roadmap
9 Systèmes logiques programmables Page 9 Généralités (suite) UMC Logic Technology Roadmap
10 Systèmes logiques programmables Page 10 Généralités (suite) AMI Semiconductors Process Roadmap
11 Systèmes logiques programmables Page 11 Généralités (suite) DRAM and Flash Production Product Generations and Chip Size Model (Int l Technology Roadmap on Semiconductor) Year of Production Flash ½ Pitch (nm) (un-contacted Poly)(f) DRAM ½ Pitch (nm) (contacted) MPU Physical Gate Length (GLph) (nm) DRAM Product Table Cell area [Ca = af2] (um 2 ) Cell array area at product (% of chip size) 56.08% 56.08% 56.08% 56.08% 56.08% 56.08% 56.08% 56.08% 56.08% Generation at production 2G 4G 4G 8G 8G 16G 32G 32G 64G Functions per chip (Gbits) Chip size at production (mm 2 ) Flash Product Table Flash ½ Pitch (nm) (un-contacted Poly)(f) Cell area [Ca = af 2 ] (um 2 ) Cell array area at product (% of chip size) 68.35% 68.35% 68.35% 68.35% 68.35% 68.35% 68.35% 68.35% 68.35% Generation at production SLC 11G 22G 16G 32G 64G 128G 256G 512G 1024g Generation at production MLC [4 bits/cell] NA NA 64G 128G 256G 512G 1024g 2048G 4096G Functions per chip (Gbits) MLC [4 bits/cell] NA NA Chip size at production (mm 2 ) SLC Bits/cm 2 at production MLC [2 bits/cell] 3.38E E E E E E E E E+11 Bits/cm 2 at production MLC [4 bits/cell] NA NA 1.07E E E E E E E+12
12 Systèmes logiques programmables Page 12 Généralités (suite) Décomposition d'un circuit intégré en unités opérationnelles Crossroads For Mixed-Signal Chips IEEE Spectrum Mars 2002
13 Systèmes logiques programmables Page 13 Généralités (suite) Crossroads For Mixed-Signal Chips IEEE Spectrum Mars 2002
14 Systèmes logiques programmables Page 14 Généralités (suite)
15 Systèmes logiques programmables Page 15 Généralités (suite) Investissements pour repousser les barrières technologiques Ø Les dépenses en R&D sur les RAM de génération 1GB dépassait les 10 milliards de $
16 Systèmes logiques programmables Page 16 Généralités (suite) Compagnies oeuvrant dans le domaine des mémoires Ø NEC Ø Toshiba Ø Mitsubishi Ø Samsung Electronics Ø Rambus Ø Micron Technology, Inc. Ø Infineon Technologies AG Ø Hynix Semiconductor Ø Winbond Electronics Corp. Ø Elpida Ø Ramtron Ø Autres
17 Systèmes logiques programmables Page 17 Mémoires mortes Programmation des '0' et '1' au niveau métal Types Ø ROM ou MROM Vcc R Vcc R Vcc R Vcc R Diode Transistor ROM Diodes Décodeur de rangée Word Line Word Line Word Line Bit Line Diode ROM Cell Bit Line Capacité? A 2 S 1 S 0 A 1 A 0 OE S Décodeur de colonne (Mux) Bit Line NMOS ROM Cell O 0 O 1
18 Systèmes logiques programmables Page 18 Mémoires mortes (suite) Types (suite) Ø PROM Bit Line Word Line Bit Line Fusible Word Line Diode Fuse PROM Cell Bipolar Fuse PROM Cell Antifusible Word Line Bit Line NMOS Antifuse PROM Cell
19 Systèmes logiques programmables Page 19 Mémoires mortes (suite) Types (suite) Ø EPROM Grille flottante / décharge de la grille par photo-courant (UV) Word Line Bit Line Grille flottante MOS EPROM Cell
20 Systèmes logiques programmables Page 20 Mémoires mortes (suite) Types (suite) Ø EEPROM 2 grilles commandées par signaux complémentaires Ø Flash EEPROM segmenté Word Line Bit Line + - MOS EEPROM Cell
21 Systèmes logiques programmables Page 21 Mémoires mortes (suite) Cartes mémoire FLASH CompactFlash Unité ~ US $7.5 milliards Secure Digital Memory On the Move IEEE Spectrum Mai 2001
22 Systèmes logiques programmables Page 22 Mémoires vives SRAM (RAM statique) 6T Ø Nécessite une alimentation Ø Conserve l'information indéfiniment Ø Accès rapide Ø Faible densité D V DD V D* DD Adr Adr Équivalent D D* Adr Adr CMOS SRAM Cell
23 Systèmes logiques programmables Page 23 Mémoires vives (suite) DRAM (RAM dynamique) Ø Nécessite une alimentation Ø Les cellules mémoires doivent être rafraîchies D Adr D Adr C C V CMP - + DRAM Cell
24 Systèmes logiques programmables Page 24 Mémoires vives (suite) DRAM (suite) Ø DRAM usuelles dans les PC Fast Page Mode RAM (FPM DRAM) Attends qu'une donnée soit lue avant d'accéder l'adresse suivante. Extended Data-out Dynamic RAM (EDO DRAM) N'attends pas que la première donnée soit traitée avant de passer à l'adresse suivante. Synchronous Dynamic RAM (SDRAM) Tire avantage qu'un processeur réquisitionne des données consécutives. Environ 5% plus rapide que la mémoire EDO pour une même fréquence. RAMBUS Dynamic RAM (RDRAM) Changement d'architecture pour le RIMM (Rambus In-line Memory Module) qui permet aux modules mémoire de travailler en parallèle. Video RAM (VRAM); Multiport Dynamic RAM (MPDRAM) Utilisée pour les cartes vidéo et accélérateurs 3D Autres (FIFO, LIFO, Multi-ports de lecture et d'écriture)
25 Systèmes logiques programmables Page 25 Mémoires vives (suite) Calendrier de lancement (roadmap) des mémoires pour les ordinateurs de bureau. DDR SDRAM = Double data rate synchronous dynamic random-access memory Rambus" Friend or Foe? IEEE Spectrum - Mai 2001
26 Systèmes logiques programmables Page 26 Mémoires vives (suite) Banques de mémoire
27 Systèmes logiques programmables Page 27 Mémoires vives (suite) Banques de mémoire A6 = Ak+1 décodeur 9 à x x x 64 A14 = An-1 A0 A1 MUX 64 à 1 MUX 64 à 1 MUX 64 à 1 A5 = Ak D0 D1 D7
28 Systèmes logiques programmables Page 28 Mémoires vives (suite) Banques de mémoire
29 Systèmes logiques programmables Page 29 Mémoires vives (suite) Banques de mémoire
30 Systèmes logiques programmables Page 30 Mémoires vives (suite) Banques de mémoire Décodeur Réseau 256 x 256 Adresse rangés A0-A7 RAS* CAS* WE* Contrôle Adresse colonnes Bistables des colonnes, multiplexeur & démultiplexeur Dout Din
31 Systèmes logiques programmables Page 31 Mémoires de masse Support magnétique Ø Disque Accès directe aux données Ø Ruban Faible coût Accès séquentiel Support optique Ø CD-ROM Ø DVD-ROM Autres Ø Disque magnéto-optique
32 Systèmes logiques programmables Page 32 Mémoires de masse (suite) Disques durs de 1 Go Memory On the Move IEEE Spectrum Mai 2001
33 Systèmes logiques programmables Page 33 Autres mémoires à semi-conducteur (suite) Technologie en émergence Ø Mémoires ferroélectriques (FRAM) Mémoire RAM non-volatile combinant la rapidité et la basse tension des SRAM avec alimentation mais élimine le besoin de pile. Avantages: Ne nécessite aucun rafraîchissement. Conserve ses données lorsque l'alimentation est coupée. Inconvénients: Capacité max. actuelle: 256 kb
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